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          • 【四旋翼飞行器】76小时吃透四轴算法!史上最强软硬结合实战项目,?戳此立抢?

            射频定时发送器的基本功能与设计方案介绍

            电子设计 ? 2020-11-30 09:11 ? 次阅读

            引言

            射频定时发送器是射频控制模块中的一个重要组成部分,用于产生需要定时发送的射频控制信号:AD_ON(模数转换信号)、DA_ON(数模转换信号)、APC(自动功率控制信号)、AGC(自动增益控制信号)和AFC(自动频率控制信号),再通过选择两个SPI接口RF_SPI和AD_SPI把控制信号定时地传送到射频发送模块。射频定时发送器需要完成的四种基本功能分别是:定时发送、竞争发送、数据采样时钟分频,以及APC_burst模式,如图1所示,本文将详细阐述这些基本功能模块的设计原理。

            射频定时发送器的基本功能与设计方案介绍

            图1 射频定时发送器功能结构图

            定时发送模块

            射频定时发送器的主要功能就是定时传输射频控制信息,为了满足此功能,需要在模块中设计两个FIFO:DATA FIFO用于存储射频控制信息;TIME FIFO用于存储时间信息。模块中设定当系统帧计数器与TIME FIFO中存储的某一时间相同时,就把与这个时间对应的射频控制信息发送出去。因此还需设计一个模块,判断当帧计数器的值等于FIFO_time(FIFO中存储的时间)时,产生使能信号(read_en, fifo_read_en, time_int)发送信息,工作流程如图2所示。

            射频定时发送器的基本功能与设计方案介绍

            图2 定时发送射频控制信息设计流程图

            FIFO

            该模块中将设计两个FIFO,它们将需要发送的射频控制信息及其发送时间缓存起来,设计用FIFO进行存储的目的是将这两种信息一一对应起来,避免发送的时候出错。

            define data_fifo

            module data_fifo (rst_,clk,we_i,rd_i, addwr_i,addrd_i,fifo_data_i,fifo_data_o);

            1) 首先定义该模块的信号线:输入信号为rst_ (复位信号)、clk(标准时钟)、 we_i(写信号)、 rd_i(读信号)、addwr_i[4:0](写FIFO地址)、 addrd_i[4:0](读FIFO地址)和fifo_data_i[11:0](写入FIFO的值);输出信号为fifo_data_o[11:0] (FIFO输出值)。

            2) 再定义一个宽度为12位、深度为32的FIFO:reg [11:0] register_fifo[0:31];

            3) 设计写FIFO的情况:以clk为参考时钟,首先判断复位信号,当复位信号为低时,对FIFO进行复位:if(!rst_) register_fifo[0.。..。.31] 《= 12’b0;当rst_不为低且we_i为高时,则对FIFO进行写操作:if(we_i == 1’b1) register_fifo[addwr_i] 《= fifo_data_i;

            4) 设计读FIFO的情况:同样以clk为参考时钟,先判断复位信号,当复位信号为低时,对fifo_data_o进行复位:if(!rst_) fifo_data_o《= 12’b0;当rst_不为低且rd_i为高时,则对FIFO进行读操作:if(rd_i == 1’b1) fifo_data_o 《= regsiter_fifo[addrd_i];

            使能信号及中断产生模块

            FIFO读/写使能信号是由外部模块驱动的,因此需要设计一个模块用于产生控制FIFO的读/写信号,并且该模块还需产生时间中断信号用于使能发送器。

            define transfer time

            module time_count(rst_,clk,fifo _time,framc,read_en,fifo_read _en,time_int);

            1) 首先定义该模块的信号线:输入信号为rst_、clk、 fifo_time[15:0](FIFO中存储的时间信息)、framc(帧计数器值);输出信号为read_en(FIFO地址累加使能信号)、 fifo_read_en(读FIFO值使能信号)、time_int(时间中断信号);再定义一个reg [1:0] time_int_delay,用于存储time_int在上一个时钟的信息,如time_int_delay[0] 《= time_int; time_int_delay[1] 《= time_int_delay[0];

            2) 定义fifo_read_en信号在time_int被拉高后延迟一个clk拉高,再延迟一个clk拉低,即assign fifo_read_en = time_int |(time_int_delay[0]);定义read_en信号在time_int被拉高后延迟两个clk后拉高,再延迟一个clk拉低,即 assgin read_en = time_int_delay[0] |(time_int_delay[1])。这样做的目的是控制在当前clk的上升沿到来时取出FIFO中当前地址的值,然后在下一个clk的上升沿立即计算出下一次取值的地址,这样就能保证在每一次取值之前其所在的位置已经计算完成,避免了取值出错的情况。

            3) 最后定义如何产生time_int信号。time_int产生的条件是:当fifo_time中存储的时间信息等于framc时,time_int被拉高,即被使能,if(fifo_time== framc ) time_int 《= 1‘b1;

            FIFO读写操作的仿真结果如图3所示,对FIFO的读/写操作分别由we_i和rd_i(fifo_read_en)控制,而计算读FIFO的地址由read_en控制,这样就能保证在每次取FIFO值之前其所在地址已经被计算完成。

            射频定时发送器的基本功能与设计方案介绍

            图3 FIFO读/写操作仿真图

            竞争发送模块

            芯片在空闲情况下,可能会有空闲状态的射频控制信息(idle_data)需要发送,当芯片唤醒后则应优先发送该信息。但当芯片唤醒后产生的射频控制信息fifo_data与idle_data在同一时刻发送时,就会出现竞争发送的情况。因此,在设计该模块时限定当idle_en(空闲使能信号)与pllon(pll时钟使能信号)同时拉高时,发送idle_data中的相应比特来取代fifo_data中的相应比特,如图4所示。

            射频定时发送器的基本功能与设计方案介绍

            图4 射频定时发送器在空闲情况下的工作流程

            transfer idle_data and fifo_data:

            module idle_time(fifo_ data,pllon,idle_en,idle_data,rfctrl_o);

            1) 定义该模块的信号线:输入信号为fifo_data[11:0](FIFO中存储的射频控制信息)、idle_data (空闲时需发送的射频控制信息)、idle_en、pllon;输出信号为rfctrl_o(最后输出的射频控制信息)。

            2) 下面对需发送的控制信息进行逻辑组合。其敏感电平是pllon、fifo_data、idle_data和idle_en,即当上述电平中任意一个发生变化时,就执行下面的语句:

            always @(pllon or fifo_data or idle_data or idle_en)//组合逻辑电路

            begin

            rfctrl_o[0] = (idle_en[0])?idle_ data[0]:fifo_data[0];

            rfctrl_o[1] = (idle_en[1])?idle_ data[1]:fifo_data[1];

            rfctrl_o[2] = (idle_en[2])?idle_ data[2]:fifo_data[2];

            rfctrl_o[3] = (idle_en[3])?idle_ data[3]:fifo_data[3];

            rfctrl_o[4] = (idle_en[4])?idle_ data[4]:fifo_data[4];

            。..。..。..。..。.. 。..。..。..。..。..。. 。..。..。..。..。.

            end

            竞争发送的仿真结果如图5所示:在pllon没有被拉高的情况下,rfctrl_o发送的就是fifo_data的值,只有当pllon被拉高的条件下才会有竞争发送的情况。

            数据采样时钟分频模块

            为了数据发送同步,射频定时发送器输出数据的频率应与外接模块保持一致,射频定时发送器采样发送数据的时钟是系统时钟的分频时钟。因此,产生分频时钟和采样使能信号是该模块设计的关键所在,并要求每次对发送数据的采样都应发生在分频时钟的上升沿。

            generator ad_clk and send ad_sdatao:

            module drv_clk(rst_,clk,frq_ drv,ad_sclk,spi_en,rfctrl_data,ad_datao);

            1) 定义该模块的信号线:输入信号为rst_、 clk、 frq_drv(分频系数)、rfctrl_data(射频控制信息);输出信号为ad_sclk(分频时钟)、ad_sdatao(发送数据)。

            2) 以clk为基准时钟,定义一个reg[3:0] count计数器对clk的上升沿进行计数。当count=frq_drv-1时,ad_sclk进行反转并对count清零,这样就产生了分频时钟。

            3) 该模块设计要求每次对发送数据的采样都应发生在分频时钟的上升沿。但为了避免产生异步,对数据进行采样时不能以产生的ad_sclk为标准,应仍以clk为基准时钟。即在每8个clk时钟的上升沿发送1位的rfctrl_data,并由高位到低位发送,这样采样时就不会出现毛刺,能做到较好的同步。

            always @(posedge clk or negedge rst_)

            begin

            count 《= count+1

            if(count == 2*frq_drv-1)

            begin

            ad_sdatao 《= rfctrl_data[11]; //每次发送rfctrl_data的最高bit

            rfctrl_data[11:0] 《= {rfctrl_data[10:0], 1’b0};

            //然后rfctrl_data[11:0]左移一位,去除已发送的bit

            end

            end

            这种方式能确保在每一个ad_sclk的上升沿对发送数据的数据进行采样,避免了产生毛刺。

            射频定时发送器的基本功能与设计方案介绍

            图5 竞争发送仿真图

            burst发送模式设计

            为了使发送功率更加稳定,射频定时发送器中设计了一种burst模式,即把一次性需要发送的功率分为几步发送出去,并规定了每步发送的功率值=step_value*para(每步值×增益),这样就可以避免在发送功率控制信息时产生突激。

            burst step design:

            module burst(rst_,clk,apc_ flag_i,step0.。...step11,para,ad_s datao,apc_burst_en,apc_burstout);

            1) 定义该模块的信号线:输入信号为rst_、 clk、 apc_flag_i(apc标志信号)、step0.。...step11 (每步需发送的功率值)、para(每步增益)、apc_burst_en(burst模式使能信号);输出信号为apc_burstout(每步最终发送的功率)、ad_sdatao(发送数据)。

            2) 定义assign apc_burstout = step_value*para,设置step_count记录目前发送的步数,并根据step_count的信息,用step_value存储当前步数的值。

            always @(posedge clk or negedge rst_)

            begin

            case(step_count)

            2‘b00: step_value[11:0]《= step0[11:0];

            2’b01: step_value[11:0]《= step1[11:0];

            2‘b10: step_value[11:0]《= step2[11:0];

            。..。..。..。..。..。.

            endcase

            end

            3) 最后定义当每次apc_burst_en使能时,step_count累加。

            仿真结果如图6所示:当apc_flag_i拉高时,射频控制信息开始从0步到11步分步发送;当apc_flag_i拉低时,再从第12步到第1步发送。

            射频定时发送器的基本功能与设计方案介绍

            图6 APC在burst模式下发送数据的仿真结果时序图

            结语

            作为射频控制模块中的重要部分,射频定时发送器能够定时发送射频控制信息,并能根据实际情况调整发送模式。本文对该模块最重要的四大功能模块,即定时发送模块、竞争发送模块、分频采样时钟模块以及burst模式发送模块的设计方案作了基本介绍,希望对芯片设计人员有所帮助。

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            发表于 01-09 08:00 ? 43次 阅读
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            PROTUES教程之PROTUES快速入门教程免费下载

            本文档的主要内容详细介绍的是PROTUES教程之PROTUES快速入门教程免费下载 1Proteus....
            发表于 01-09 08:00 ? 88次 阅读
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            SN74HC4040A 12 位异步二进制计数器

            与其它产品相比?计数器/算术/奇偶校验功能 ? Technology Family VCC (Min) (V) VCC (Max) (V) Rating Operating temperature range (C) Package Group ? SN74HC4040A HC ? ? 2 ? ? 6 ? ? Catalog ? ? -40 to 85 ? ? SO | 16 TSSOP | 16 ? ?
            发表于 01-08 17:46 ? 18次 阅读
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            02:应用于DAS和小型基站的射频产品解决方案

            本次会议将介绍恩智浦成熟的射频产品解决方案,广泛应用于DAS和小型基站,功率范围从0.5W、10W到....
            的头像 NXP视频 发表于 01-08 07:08 ? 136次 观看
            02:应用于DAS和小型基站的射频产品解决方案

            应用于DAS和小型基站的射频产品解决方案

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            罗森伯格陪你做车载 ——车载射频高速连接器之趋肤效应

            罗森伯格高压产品大客户经理周同昌先生解读了关于电磁屏蔽测试的理论知识和三同轴测试系统,文章受到了大家....
            的头像 人间烟火123 发表于 01-04 18:02 ? 2479次 阅读
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            射频前端的成本伴随着LTE网络逐步提升

            提及射频前端,相信不少朋友对射频前端还不太了解。它是射频收发器和天线之间的一系列组件,主要包括功率放....
            的头像 电子资讯网工程师 发表于 01-03 11:26 ? 1335次 阅读
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            单片机的12个汇编实例详细资料说明

            本文档的主要内容详细介绍的是单片机的12个汇编实例详细资料说明主要内容包括了:1. 闪烁灯,2.模拟....
            发表于 01-03 09:09 ? 101次 阅读
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            FPGA各种数字电路模拟的详细资料合集免费下载

            本文档的主要内容详细介绍的是FPGA各种数字电路模拟的详细资料合集免费下载主要内容包括了:4 位全加....
            发表于 01-02 17:35 ? 141次 阅读
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            VHDL教程之VHDL模块电路原理图画法的详细资料说明

            一、创建VHDL模块,生成一个原理图符号1、在项目导航器(Project Navigator)菜单中....
            发表于 01-02 16:59 ? 46次 阅读
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            罗德与施瓦茨、iBwave和Anokiwave这三家公司已经计划、实施并测试了室内5GNR网络

            5G的商业推广工作即将展开。作为射频和微波测试和测量设备的全球市场和技术的领先者,罗德与施瓦茨的产品....
            的头像 罗德与施瓦茨资讯 发表于 12-27 16:53 ? 1215次 阅读
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            STM32定时器基本计数原理解析

            STM32的TIM定时器分为三类:基本定时器、通用定时器和高级定时器。从分类来看就知道STM32的定....
            发表于 12-27 16:20 ? 174次 阅读
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            通用定时器的功能和组成介绍

            本文档的主要内容详细介绍的是通用定时器的功能和组成介绍资料免费下载
            发表于 12-27 08:00 ? 132次 阅读
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            FPGA学习合集教程之开发板数据手册和三个仿真测试的视频教程

            本文档的主要内容详细介绍的是FPGA学习合集教程之开发板数据手册和三个仿真测试的视频教程内容包括了:....
            发表于 12-27 08:00 ? 292次 阅读
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            AVR单片机比较匹配清零计数器模式的操作步骤及过程

            当计数器TCNT0的数值等于比较寄存器OCR0时计数器TCNT0自动清零。OCR0定义了计数器的最大....
            发表于 12-26 15:42 ? 99次 阅读
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            功率放大器的过驱动和欠驱动详细资料说明

            这里的分析仍然基于这样一个基本假设:PA 器件的输入-输出转移特性是理想的夹断、线性和饱和特性,如下....
            发表于 12-25 17:17 ? 302次 阅读
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            SilTerra开发MEMS-on-CMOS平台扩展新应用

            SilTerra一直在开发其MEMS-on-CMOS平台,并将其扩展到新的应用,例如:医疗和指纹传感....
            的头像 MEMS 发表于 12-23 14:20 ? 721次 阅读
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            基于高速数据转换器的更高频率射频采样

            多年来,数字收发机被应用在多种类型的应用中,包括地面蜂窝网络、卫星通信和基于雷达的监视、地球观测和监....
            发表于 12-22 14:41 ? 465次 阅读
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            RF信号调制的基础理论和承载数据

            无线信号的传播以“电磁波”为介质。发送方可以将交变电流发送到导线上,建立电场和磁场,并以行进波的方式....
            发表于 12-22 11:47 ? 199次 阅读
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            射频RFID信号攻击模拟效果探讨

            国内外频发各种RFID攻击事件,一些黑客利用RFID技术破解各种消费卡、充值卡,然后盗刷恶意充值消费....
            发表于 12-22 11:34 ? 281次 阅读
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            单片机定时器和计数器的类型及工作原理解析

            在51单片机中,分为软件定时器,不可编程硬件定时器,可编程定时器。 软件定时:CPU每执行一条....
            发表于 12-21 15:16 ? 236次 阅读
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            PIC16C5X单片机内部结构组成及工作原理解析

            PIC16C5X在一个芯片上集成了一个8位算术逻辑单元ALU和工作寄存器(W);384~2K的12位....
            发表于 12-20 16:07 ? 137次 阅读
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            51单片机对计数器的数值显示设计

            我们的硬件中是这样连线的:324组成的振荡器连到定时/计数器1的外部管脚T1上面,我们就利用这个来做....
            发表于 12-19 15:30 ? 178次 阅读
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            振芯科技储备5G相关射频收发技术

            12月14日,振芯科技在互动平台上表示,目前储备了5G领域相关射频收发等技术,未来将视行业情况开展产....
            的头像 半导体投资联盟 发表于 12-19 13:40 ? 574次 阅读
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            单片机定时计数器及外部中断实验的详细电路图和源代码资料免费下载

            本文档的主要内容详细介绍的是单片机定时计数器及外部中断实验的详细电路图和源代码资料免费下载。
            发表于 12-19 08:00 ? 80次 阅读
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            本土射频企业未发生整合的原因,国内射频企业如何弥补差距

            他指出两家国际RFFE巨头的研发投入,每家每年20-25亿人民币,而国内七家研发强度较大的射频公司每....
            的头像 电子资讯网工程师 发表于 12-17 16:54 ? 1971次 阅读
            本土射频企业未发生整合的原因,国内射频企业如何弥补差距

            射频教程之射频的基本概念和知识华为射频培训课件免费下载

            射频子系统位于整个基站的最前端,是整个NodeB系统正常运行的关键环节之一。本胶片主要讲述射频基本概....
            发表于 12-17 08:00 ? 224次 阅读
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            RFID入门教程之RFID基础知识详细资料大全免费下载

            RFID是Radio Frequency Identification的缩写,即射频识别。常称为感应....
            发表于 12-17 08:00 ? 144次 阅读
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            想要生产5G设备 射频前端是其中重要的一环

            2018年是5G快速发展的一年,这一年里不仅确立了5G标准,同时许多厂商也正式宣布向5G领域发起冲锋....
            发表于 12-15 11:17 ? 703次 阅读
            想要生产5G设备 射频前端是其中重要的一环

            RFS推出2款新品 丰富了其备受欢迎的RFX-TREME三频天线产品系列

            全球无线和广播基础设施领域专家安弗施无线射频系统公司(RFS)日前宣布,推出2款新型号的天线APXV....
            发表于 12-14 15:32 ? 310次 阅读
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            2018年全球射频光纤传输市场复合年增长率为10.97%

            根据Markets and Markets的报告,全球射频光纤传输(RF-over-fiber)市场....
            发表于 12-13 15:30 ? 178次 阅读
            2018年全球射频光纤传输市场复合年增长率为10.97%

            比克科技发布两款射频新品 快速射频信号合成器频率范围300KHZ到8GHz

            英国比克科技(Pico Technology)于2020年11月30日在慕尼黑印度电子展和欧洲微波展同....
            发表于 12-13 15:24 ? 198次 阅读
            比克科技发布两款射频新品 快速射频信号合成器频率范围300KHZ到8GHz

            带你走进手机的集成电路电子生态系统

            目前主流的设计是只将射频收发器(小信号部分)集成到手机基带中,未来射频前端也有可能集成到手机基带里。
            的头像 PCB开门网 发表于 12-11 11:30 ? 994次 阅读
            带你走进手机的集成电路电子生态系统

            如何采用STM32中的控制定时器Tim1实现计数器功能

            STM32中的高级控制定时器(Tim1)是由一个16位的自动装载计数器组成,它由一个可编程预分频器驱....
            发表于 12-10 15:25 ? 246次 阅读
            如何采用STM32中的控制定时器Tim1实现计数器功能

            CD54HC190 高速 CMOS 逻辑可预设的同步 4 位 BCD 码十进制加/减计数器

            CD54 /74HC190是异步预设的BCD十进制计数器,而CD54 /74HC191和CD54 /74HCT191是异步预设的二进制计数器。 通过低异步并行负载(LOAD)输入完成预置数字输入(A ?? D)上的数字预置。当LOAD \为高电平,计数使能(CTEN)为低电平时,计数发生,向下/向上(D /U)输入为低电平表示减计数或低电平表示向上计数。计数器与时钟从低到高的转换同步递减或递增。 当计数器发生上溢或下溢时,MAX /MIN输出(在计数期间为低电平)变高并且在一个时钟周期内保持高电平。此输出可用于高速级联中的先行进位(参见图1)。 MAX /MIN输出还启动纹波时钟(RCO)输出,该输出通常为高电平,变为低电平,并在时钟脉冲的低电平部分保持低电平。这些计数器可以使用RCO \进行级联(参见图2)。 如果将十进制计数器预设为非法状态或在接通电源时采用非法状态,则会返回正常序列中的一个或两个计数,如状态图所示(见图3)。 特性 2-V至6-VV CC 操作(?? HC190,191) 4.5 V至5.5 VV CC 操作(?? HCT191) 55至125°C的宽工作温度范围 同步计数和...
            发表于 11-02 19:21 ? 9次 阅读
            CD54HC190 高速 CMOS 逻辑可预设的同步 4 位 BCD 码十进制加/减计数器

            CD54AC161 具有异步复位的同步可预设的二进制计数器

            ?? AC161设备是4位二进制计数器。这些同步可预置计数器具有内部进位预测功能,适用于高速计数应用。这些器件完全可编程;也就是说,它们可以预设为0到9或15之间的任何数字。预设是同步的;因此,在负载输入处设置低电平会禁用计数器,并使输出在下一个时钟脉冲之后与设置数据一致,无论使能输入的电平如何。 清除功能是异步。清零(CLR)\输入的低电平将所有四个触发器输出设置为低电平,无论CLK,负载(LOAD)\或使能输入的电平如何。 进位外观 - 前端电路为n位同步应用提供级联计数器,无需额外的门控。有助于实现此功能的是ENP,ENT和纹波进位输出(RCO)。 ENP和ENT都必须高计数,并且ENT被前馈以启用RCO。当计数最大时(9或15,Q A 为高电平),启用RCO会产生高电平脉冲。这种高电平溢出纹波进位脉冲可用于实现连续级联级。无论CLK的电平如何,都允许ENP或ENT的转换。 计数器具有完全独立的时钟电路。在发生计时之前,修改操作模式的控制输入(ENP,ENT或LOAD \)的更改不会影响计数器的内容。计数器的功能(无论是启用,禁用,加载还是计数)仅由满足稳定设置和保持时间的条件决定。 特性 快速...
            发表于 11-02 19:21 ? 4次 阅读
            CD54AC161 具有异步复位的同步可预设的二进制计数器

            CD54AC280 9 位奇偶校验发生器/校验器

            ?? AC280和?? ACT280是采用高级CMOS逻辑技术的9位奇数/偶数奇偶校验发生器/检查器。偶数和奇数奇偶校验输出均可用于检查或生成长达9位的字的奇偶校验。甚至指示奇偶校验( E输出到另外的任何输入?AC280,?? ACT280奇偶校验器。 特性 缓冲输入 典型传播延迟 - 在V CC = 5V时为10ns ,T A = 25°C,C L = 50pF 超过MIL-STD-883的2kV ESD;,方法3015 耐SCR闩锁CMOS工艺和电路设计 功耗显着降低的双极FAST ?? /AS /S速度 平衡传播延迟 < li> AC类型具有1.5V至5.5V的工作电压和30%电源的均衡噪声抗扰度 ±24mA输出驱动电流 - 扇出至15 FAST ??集成电路 - 驱动器50 传输线 表征操作来自?? 40°至85°C FAST ??是飞兆半导体的商标。 参数 与其它产品相比?计数器/运算器/奇偶校验功能产品 ? Technology Family VCC (Min) (V) VCC (Max) (V) Bits (#) Voltage (Nom) (V) F @ Nom Voltage (Max) (Mhz) ICC @ Nom Voltage (Max) (mA) tpd @ Nom Voltage (Max) (ns) IOL (Max) (mA) Function Type...
            发表于 11-02 19:21 ? 2次 阅读
            CD54AC280 9 位奇偶校验发生器/校验器

            CD4060B-MIL CMOS 14 级纹波进位二进制计数器/除法器和振荡器

            CD4060B由振荡器部分和14个纹波进位二进制计数器级组成。振荡器配置允许设计RC或晶体振荡器电路。提供RESET输入,将计数器复位到全O状态并禁用振荡器。 RESET线上的高电平完成复位功能。所有计数器阶段都是主从触发器。在 O )。所有输入和输出均完全缓冲。施密特触发器对输入脉冲线的作用允许无限制的输入脉冲上升和下降时间。 CD4060B系列类型采用16引脚密封双列直插式陶瓷封装(F3A后缀), 16引脚双列直插塑料封装(E后缀),16引脚小外形封装(M,M96,MT和NSR后缀),以及16引脚薄型收缩小外形封装(PW和PWR后缀)。 特性 15 V时12 MHz时钟频率 常用复位 完全静态操作 缓冲输入和输出 施密特触发器输入脉冲线 在20 V下测试静态电流100% 标准化,对称输出特性< /li> 5 V,10 V和15 V参数额定值 符合JEDEC暂定标准No. 13B的所有要求,“B ??系列说明的标准规范” CMOS器件?? 振荡器特性: 芯片上的所有有源元件 RC或晶体振荡器配置 RC振荡器频率为690 kHz最小电压15 V 应用 控制计数器 定时器 分频器 延时电路 参数 与其它产品相比?计数器/运算器/奇偶校验功能产品 ...
            发表于 11-02 19:21 ? 35次 阅读
            CD4060B-MIL CMOS 14 级纹波进位二进制计数器/除法器和振荡器

            CD40193B-MIL CMOS 可预设置的二进制加/减计数器(具有双时钟和复位功能)

            CD40192b可??预置BCD向上/向下计数器和CD40193B可预设二进制向上/向下计数器均由4个同步时钟控制的门控“D”型触发器组成作为一个柜台。输入包括4个独立的阻塞线,一个PRESET \ ENABLE \控制,单独的CLOCK UP和CLOCK DOWN信号以及一个主RESET。提供四个缓冲Q信号输出以及用于多级计数方案的CARRY \和BORROW \输出。 计数器被清零,以便所有输出在RESET线上处于低电平状态。 RESET与时钟异步完成。当PRESET \ ENABLE \控制为低电平时,每个输出都可以与相应的卡纸输入电平的时钟异步编程。 计数器在CLOCK UP信号的正时钟沿计数一个计数如果CLOCK DOWN线为高电平。如果CLOCK UP线为高电平,计数器会对CLOCK DOWN信号的正时钟沿计数递减计数。 CARRY \和BORROW \信号为高电平,计数器向上或向下计数。在计数器达到计数模式下的最大计数后,CARRY \信号在半个时钟周期内变为低电平。在计数器达到倒计数模式下的最小计数后,BORROW \信号在半个时钟周期内变为低电平。通过将BORROW \和CARRY \输出分别连接到后续计数器...
            发表于 11-02 19:21 ? 4次 阅读
            CD40193B-MIL CMOS 可预设置的二进制加/减计数器(具有双时钟和复位功能)

            CD40161B-MIL 具有异步清零功能的 CMOS 同步可编程 4 位二进制计数器

            CD40160B,CD40161B,CD40162B和CD40163B是4位同步可编程计数器。 CD40162B和CD40163B的CLEAR功能是同步的,CLEAR \输入的低电平在下一个正的CLOCK边沿将所有四个输出设置为低电平。 CD40160B和CD40161B的CLEAR功能是异步的,CLEAR \输入的低电平将所有四个输出设置为低电平,而不管CLOCK,LOAD \或ENABLE输入的状态如何。 LOAD \输入的低电平禁用计数器,并使输出与下一个CLOCK脉冲后的设置数据一致,无论ENABLE输入的条件如何。 进位预测电路提供用于n位同步应用的级联计数器,无需额外的门控。完成此功能的工具有两个计数使能输入和一个进位输出(C OUT )。当PE和TE输入均为高电平时,计数启用。 TE输入被前馈以使能C OUT 。该使能输出产生正输出脉冲,其持续时间约等于Q1输出的正部分。该正溢出进位脉冲可用于实现连续级联级。当时钟为高电平或低电平时,可能会发生PE或TE输入的逻辑转换。 CD40160B类型采用16引脚密封双列直插式陶瓷封装(F3A后缀)。 CD40161B型采用16引脚密封双列直插式陶瓷封装(F3A后缀),16引脚双列直插塑料封装(E后...
            发表于 11-02 19:21 ? 60次 阅读
            CD40161B-MIL 具有异步清零功能的 CMOS 同步可编程 4 位二进制计数器

            CD4518B-MIL CMOS 双路 BCD 加计数器

            CD4518双BCD上行计数器和CD4520双二进制上行计数器均由两个相同的内部同步4级计数器组成。计数器级是D型触发器,具有可互换的CLOCK和ENABLE线,用于递增正向或负向转换。对于单机操作,ENABLE输入保持高电平,计数器在CLOCK的每个正向转换时前进。计数器在其RESET线上被高电平清零。 通过将Q4连接到后续计数器的使能输入,同时后者的CLOCK输入保持低电平,可以在纹波模式下级联计数器。 CD4518B和CD4520B型采用16引脚密封双列直插陶瓷封装(F3A后缀),16引脚双列直插塑料封装(E后缀),16引脚小型-outline包(M,M96和NSR后缀)和16引脚薄收缩小外形封装(PW和PWR后缀)。 特性 中速操作 - 10 V时的6 MHz典型时钟频率 正或负 - 边沿触发 同步内部进位传播 100%测试20 V时的静态电流 在整个封装温度下,18 V时的最大输入电流为1μA范围;在18 V和25°C下100 nA 噪声容限(在整个封装温度范围内): 1 V,V DD = 5 V 2 V V DD = 10 V 2.5 V V DD = 15 V 5 V,10 V和15 V参数额定值 标准化,对称输出特性 符合JEDEC暂定标准No. 13B的所有...
            发表于 11-02 19:21 ? 6次 阅读
            CD4518B-MIL CMOS 双路 BCD 加计数器

            CD54HC161 具有异步复位的高速 CMOS 逻辑 4 位二进制计数器

            ?? HC161,?? HCT161,?? HC163和?? HCT163是可预设的同步计数器,具有先行进位逻辑,可用于高电平高速计数应用程序。 ?? HC161和?? HCT161分别是异步复位十进制和二进制计数器; ?? HC163和?? HCT163器件分别是十进制和二进制计数器,它们与时钟同步复位。计数和并行预置都与时钟的负到正转换同步完成。 同步并行使能输入SPE的低电平禁用计数操作并允许P0到P3的数据输入要加载到计数器中(前提是满足SPE的建立和保持要求)。 所有计数器在主复位输入MR上以低电平复位。在?? HC163和?? HCT163计数器(同步复位类型)中,必须满足相对于时钟的建立和保持时间要求。 每个计数器中有两个计数使能,PE和TE提供n位级联。在所有计数器中,无论SPE \,PE和TE输入的电平(以及时钟输入,CP,在?? HC161和?? HCT161类型中)都会发生复位操作。 如果是十年计数器当电源被施加电源时,它被预置为非法状态或呈现非法状态,它将以一个计数返回到正常序列,如状态图所示。 先行进位功能简化了串行级联计数器。两个计数使能输入(PE和TE)必须为高才能计数。 TE输入通过所有四个级的Q输出进行门控,以便在最大计数时,终...
            发表于 11-02 19:21 ? 2次 阅读
            CD54HC161 具有异步复位的高速 CMOS 逻辑 4 位二进制计数器

            CD54AC283 具有快速进位的 4 位二进制全加器

            具有快速进位的?? AC283和?? ACT283 4位二进制加法器,采用先进的CMOS逻辑技术。如果总和超过15,这些器件会添加两个4位二进制数并生成进位。 由于add函数的对称性,该器件可与所有高电平有效操作数一起使用(正逻辑)或所有低电平有效操作数(负逻辑)。使用正逻辑时,如果没有进位,则必须将进位输入连接为低电平。 特性 缓冲输入 超过2kV ESD;IL-STD-883,方法3015 SCR -Lackup-Resistant CMOS工艺和电路设计 双极FAST ?? /AS /S速度显着降低功耗 平衡传播延迟 AC类型具有1.5V至5.5V的工作电压和30%供电时的平衡噪声抗扰度 ±24mA输出驱动电流 - 扇出至15 FAST ??集成电路 - 驱动器50 传输线 表征操作来自?? 40°至85°C FAST ??是Fairchild Semiconductor的商标。 参数 与其它产品相比?计数器/运算器/奇偶校验功能产品 ? Technology Family VCC (Min) (V) VCC (Max) (V) Bits (#) Voltage (Nom) (V) F @ Nom Voltage (Max) (Mhz) ICC @ Nom Voltage (Max) (mA) tpd @ Nom Voltage (Max) (ns) IOL (Max) (mA) ...
            发表于 11-02 19:21 ? 6次 阅读
            CD54AC283 具有快速进位的 4 位二进制全加器

            CD4516B-MIL CMOS 可预设置的二进制加/减计数器

            CD4510B可预置BCD向上/向下计数器和CD4516可预置二进制向上/向下计数器由四个同步时钟控制的D型触发器组成(带有门控结构)提供T型触发器功能)作为计数器连接。这些计数器可以通过RESET线上的高电平清除,并且可以通过PRESET ENABLE线上的高电平预设为卡纸输入上的任何二进制数。 CD4510B将在向上模式下最多两个时钟脉冲计数非BCD计数器状态,在向下模式下最多四个时钟脉冲。 如果保持CARRY-IN输入低电平,计数器在每个正向时钟转换时上升或下降。同步级联是通过并联所有时钟输入并将不太重要的级的CARRY-OUT连接到更重要级的CARRY-IN来实现的。 CD4510B和CD4516B可以级联在纹波中通过将CARRY-OUT连接到下一级的时钟来实现模式。如果在终端计数期间UP /DOWN输入发生变化,则必须使用时钟门控CARRY-OUT,并且在时钟为高电平时必须更改UP /DOWN输入。该方法为随后的计数阶段提供干净的时钟信号。 (见图15)。 这些器件类似于MC14510和MC14516。 CD4510B和CD4516B类型采用16引脚双列直插塑料封装( E后缀),16引脚小外形封装(NSR后缀)和16引脚薄缩小外...
            发表于 11-02 19:21 ? 20次 阅读
            CD4516B-MIL CMOS 可预设置的二进制加/减计数器

            CD4017B-MIL 具有 10 个解码输出的 CMOS 十进制计数器

            CD4017B和CD4022B分别是具有10和8个解码输出的5级和4级Johnson计数器。输入包括CLOCK,RESET和CLOCK INHIBIT信号。 CLOCK输入电路中的施密特触发器动作提供脉冲整形,允许无限制的时钟输入脉冲上升和下降时间。 如果CLOCK INHIBIT信号为低电平,这些计数器在正时钟信号转换时提前一位计数。当CLOCK INHIBIT siganl为高电平时,禁止通过时钟线的计数器前进。高RESET信号将计数器清零至零计数。 Johnson计数器配置的使用允许高速操作,2输入解码门控和无尖峰解码输出。提供防锁定门控,从而确保正确的计数顺序。解码输出通常为低并且仅在它们各自的解码时隙处变高。每个解码输出在一个完整时钟周期内保持高电平。 CAR40-B信号在CD4017B中每10个时钟输入周期或CD4022B中每8个时钟输入周期完成一次,用于在多器件计数链中对后续器件进行纹波时钟。 CD4017B和CD4022B采用16引脚密封双列直插式陶瓷封装(F3A后缀),16引脚双列直插塑料封装(E后缀),16引脚小外形封装(NSR后缀)和16引脚薄收缩小外形封装(PW和PWR后缀)。 CD4017B类型还提供16引脚小外形封装(M和M9...
            发表于 11-02 19:21 ? 6次 阅读
            CD4017B-MIL 具有 10 个解码输出的 CMOS 十进制计数器

            CD54ACT283 具有快速进位的 4 位二进制全加器

            具有快速进位的?? AC283和?? ACT283 4位二进制加法器,采用先进的CMOS逻辑技术。如果总和超过15,这些器件会添加两个4位二进制数并生成进位。 由于add函数的对称性,该器件可与所有高电平有效操作数一起使用(正逻辑)或所有低电平有效操作数(负逻辑)。使用正逻辑时,如果没有进位,则必须将进位输入连接为低电平。 特性 缓冲输入 超过2kV ESD;IL-STD-883,方法3015 SCR -Lackup-Resistant CMOS工艺和电路设计 双极FAST ?? /AS /S速度显着降低功耗 平衡传播延迟 AC类型具有1.5V至5.5V的工作电压和30%供电时的平衡噪声抗扰度 ±24mA输出驱动电流 - 扇出至15 FAST ??集成电路 - 驱动器50 传输线 表征操作来自?? 40°至85°C FAST ??是Fairchild Semiconductor的商标。 参数 与其它产品相比?计数器/运算器/奇偶校验功能产品 ? Technology Family VCC (Min) (V) VCC (Max) (V) Bits (#) Voltage (Nom) (V) F @ Nom Voltage (Max) (Mhz) ICC @ Nom Voltage (Max) (mA) tpd @ Nom Voltage (Max) (ns) IOL (Max) (mA) ...
            发表于 11-02 19:21 ? 7次 阅读
            CD54ACT283 具有快速进位的 4 位二进制全加器

            CD4018B-MIL CMOS 可预设置 N 分频计数器

            CD4018B类型包括5个Johnson-Counter阶段,每个阶段的缓冲Q输出和计数器预设控制选通。提供时钟,复位,数据,预设启用和5个单独的JAM输入。通过将Q \ 5,Q \ 4,Q \ 3,Q \ 2,Q \ 1信号分别馈送回DATA输入,可以实现10,8,6,4或2个计数器配置的除法。通过使用CD4011B来控制到DATA输入的反馈连接,可以实现9,7,5或3个除计数器配置。通过使用多个CD4018B单元可以实现大于10的除法功能。计数器在正时钟信号转换时提前计数一次。时钟线上的施密特触发器动作允许无限制的时钟上升和下降时间。高RESET信号将计数器清零至全零状态。高PRESET-ENABLE信号允许JAM输入信息预设计数器。提供防锁定门控以确保正确的计数顺序。 CD4018B型采用16引脚密封双列直插式陶瓷封装(F3A后缀),16引脚双列直插式塑料封装(E后缀),16引脚小外形封装(M,M96,MT和NSR后缀),以及16引脚薄型收缩小外形封装(PW和PWR后缀)。 特性 中速运行???? 10 MHz(典型值)V DD ?? V SS = 10 V 完全静态工作 100%测试20 V时的静态电流 标准化,对称输出特性 5 V,10 V和15 V参数额定值 在整个封装温...
            发表于 11-02 19:21 ? 14次 阅读
            CD4018B-MIL CMOS 可预设置 N 分频计数器

            CD54HC192 高速 CMOS 逻辑可预设的同步 4 位 BCD 码十进制加/减计数器

            ?? HC192,?? HC193和?? HCT193分别是异步预置的BCD十进制和二进制向上/向下同步计数器。 < p>将计数器预设为预设数据输入(P0-P3)上的数字是通过LOW异步并行负载输入(PL)来完成的。计数器在Clock-Up输入的低到高转换(和Clock-Down输入的高电平)上递增,并在Clock-Down输入的低到高转换时递减(和高电平时钟输入)。 MR输入的高电平会覆盖任何其他输入,以将计数器清零为零状态。终端向上计数(进位)在达到零计数之前的半个时钟周期内变为低电平,并在零计数时返回高电平。倒计数模式下的终端倒计数(借用)同样在最大计数之前的半个时钟周期内变低(192中的9和193中的15)并且在最大计数时返回高。通过将较低有效计数器的进位和借位输出分别连接到下一个最重要的计数器的Clock-Up和CLock-Down输入来实现级联。 如果存在十进制计数器非法状态或在接通电源时采取非法状态,它将按一个计数返回正常顺序,如状态图所示。 特性 同步计数和异步加载 N位级联的两个输出 前瞻进行高速计数 扇出(超温范围) 标准输出。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 10 LSTTL负载 总线驱动器输出。 。 。 。 。 。 。 。 。...
            发表于 11-02 19:21 ? 24次 阅读
            CD54HC192 高速 CMOS 逻辑可预设的同步 4 位 BCD 码十进制加/减计数器

            CD40192B-MIL CMOS 可预置 BCD 加/减计数器(具有重置功能的双时钟)

            CD40192b可??预置BCD向上/向下计数器和CD40193B可预设二进制向上/向下计数器均由4个同步时钟控制的门控“D”型触发器组成作为一个柜台。输入包括4个独立的阻塞线,一个PRESET \ ENABLE \控制,单独的CLOCK UP和CLOCK DOWN信号以及一个主RESET。提供四个缓冲Q信号输出以及用于多级计数方案的CARRY \和BORROW \输出。 计数器被清零,以便所有输出在RESET线上处于低电平状态。 RESET与时钟异步完成。当PRESET \ ENABLE \控制为低电平时,每个输出都可以与相应的卡纸输入电平的时钟异步编程。 计数器在CLOCK UP信号的正时钟沿计数一个计数如果CLOCK DOWN线为高电平。如果CLOCK UP线为高电平,计数器会对CLOCK DOWN信号的正时钟沿计数递减计数。 CARRY \和BORROW \信号为高电平,计数器向上或向下计数。在计数器达到计数模式下的最大计数后,CARRY \信号在半个时钟周期内变为低电平。在计数器达到倒计数模式下的最小计数后,BORROW \信号在半个时钟周期内变为低电平。通过将BORROW \和CARRY \输出分别连接到后续计数器...
            发表于 11-02 19:21 ? 22次 阅读
            CD40192B-MIL CMOS 可预置 BCD 加/减计数器(具有重置功能的双时钟)

            CD54ACT163 具有同步复位的同步可预设的二进制计数器

            ?? ACT163器件是4位二进制计数器。这些同步可预设计数器具有内部进位前瞻功能,适用于高速计数设计。通过使所有触发器同时计时以使得输出在由计数使能(ENP,ENT)输入和内部门控指示时彼此一致地改变来提供同步操作。这种工作模式消除了通常与同步(纹波时钟)计数器相关的输出计数尖峰;撼迨敝樱–LK)输入触发时钟波形上升(正向)边沿的四个触发器。 计数器完全可编程;也就是说,它们可以预设为0到9或15之间的任何数字。预设是同步的;因此,在负载输入处设置低电平会禁用计数器,并使输出在下一个时钟脉冲之后与设置数据一致,无论使能输入的电平如何。 清除功能是同步。无论使能输入的电平如何,清零(CLR)\输入的低电平都会在CLK的下一次低电平到高电平转换后将所有四个触发器输出设置为低电平。这种同步清除允许通过解码Q输出以获得所需的最大计数来容易地修改计数长度。用于解码的门的低电平有效输出连接到CLR \以同步清除计数器0000(LLLL)。 进位超前电路为n位同步应用提供级联计数器没有额外的门控。 ENP,ENT和纹波进位输出(RCO)有助于实现此功能。 ENP和ENT都必须高计数,并且ENT被前馈以启用RCO。...
            发表于 11-02 19:20 ? 19次 阅读
            CD54ACT163 具有同步复位的同步可预设的二进制计数器

            CD4029B-MIL CMOS 可预设置的加/减计数器

            CD4029B由一个四级二进制或BCD十进制加/减计数器组成,在两种计数模式下均提供先行进位。输入包括单个CLOCK,CARRY-IN \(CLOCK ENABLE \),BINARY /DECADE,UP /DOWN,PRESET ENABLE和四个单独的JAN信号,Q1,Q2,Q3,Q4和一个CARRY OUT \信号作为输出。 高PRESET ENABLE信号允许JAM INPUTS信息将计数器预设为与时钟异步的任何状态。当每个JAM线为低电平时,当PRESET-ENABLE信号为高电平时,将计数器复位为零计数。当CARRY-IN \和PRESET ENALBE信号为低电平时,计数器在时钟正跳变时前进一次。当CARRY-IN \或PRESET ENABLE信号为高电平时,进程被禁止。 CARRY-OUT \信号通常为高电平,当计数器在UP模式下达到最大计数或在DOWN模式下达到最小计数时,如果CARRY-IN \信号为低电平,则变为低电平。处于低状态的CARRY-IN \信号因此可以被认为是CLOCK ENABLE \。不使用时,CARRY-IN \端子必须连接到V SS 。 当BINARY /DECADE输入为高电平时,完...
            发表于 11-02 19:20 ? 30次 阅读
            CD4029B-MIL CMOS 可预设置的加/减计数器

            CD4020B-MIL CMOS 14 级纹波进位二进制计数器/除法器

            CD4020B,CD4024B和CD4040B是纹波进位二进制计数器。所有计数器阶段都是主从触发器。计数器的状态对每个输入脉冲的负转变进行一次计数; RESET线上的高电平将计数器重置为全零状态。输入脉冲线上的施密特触发器动作允许无限制的上升和下降时间。所有输入和输出均经过缓冲。 CD4020B和CD4040B型采用16引脚密封双列直插式陶瓷封装(F3A后缀),16引脚双列直插塑料封装(E后缀),16引脚小外形封装(NSR后缀)和16引脚薄收缩小外形封装(PW和PWR后缀)。 CD4040B型还提供16引脚小外形封装(M和M96后缀)。 CD4024B类型采用14引脚密封双列直插陶瓷封装(F3A后缀), 14引脚双列直插塑料封装(E后缀),14引脚小外形封装(M,MT,M96和NSR后缀),以及14引脚薄型收缩小外形封装(PW和PWR后缀) 。 特性 中速操作 完全静态操作 缓冲输入和输出 100%测试20 V时的静态电流 标准化,对称输出特性 完全静态操作 常用复位 5V,10V和15V参数额定值 在整个封装温度范围内,18 V时的最大输入电流为1μA;在18 V和25°C下100 nA 噪声容限(在整个封装温度范围内): V DD = 5 V时为1 V 2 V at ...
            发表于 11-02 19:20 ? 27次 阅读
            CD4020B-MIL CMOS 14 级纹波进位二进制计数器/除法器

            SN74HC4060-Q1 汽车类 14 级异步二进制计数器和振荡器

            HC4060-Q1器件包含一个振荡器部分和14个纹波进位二进制计数器级。此振荡器配置可实现RC-或者晶体振荡器电路设计。时钟(CLKI)输入上的高到低转换增加了计数器的值。清除(CLR)输入上的高电平会关闭振荡器( CLKO 变为高电平而CLKO变为低电平)并且将计数器复位清零(所有的Q输出为低电平)。 特性 符合汽车应用要求 2V至6V的宽运行电压范围 输出可驱动多达10个低功耗肖特基晶体管逻辑电路(LSTTL)负载 低功耗,I CC 最大80μA t pd 典型值= 14 ns ±4mA输出驱动(在5V时间) 低输出电流,最大值1μA 实现相移振荡电路(RC) - 或者晶体振荡器电路的设计 参数 与其它产品相比?计数器/算术/奇偶校验功能 ? Technology Family VCC (Min) (V) VCC (Max) (V) Bits (#) Voltage (Nom) (V) F @ Nom Voltage (Max) (Mhz) ICC @ Nom Voltage (Max) (mA) tpd @ Nom Voltage (Max) (ns) IOL (Max) (mA) IOH (Max) (mA) Function Type Rating Operating Temperature Range (C) Pin/Package ? var ...
            发表于 10-16 10:08 ? 28次 阅读
            SN74HC4060-Q1 汽车类 14 级异步二进制计数器和振荡器